LOGIQUE PROGRAMMABLE EN VERILOG
Chapitre 1. Introduction
Chapitre 2. Traitement combinatoire et syntaxe du langage
2.1. Le module
2.2. Les entrées - sorties
2.3. Les niveaux logiques
2.4. Le corps du programme
2.5. Les opérations logiques binaires
2.6. Les opérations logiques unaires
2.7. Les opérations arithmétiques
2.8. Les bus
2.9. La déclaration de paramètre
2.10. La concaténation
2.11. Exemple: l'additionneur 1 bit complet
2.12. Taille et codage des nombres
2.13. Extension des modules
2.14. Avantages et Inconvénients des différentes approches sur un exemple
2.15. Exercices
2.16. Solution des exercices
2.16.1. Des OU exclusif
2.16.2. La Bascule RS
2.16.3. Encodeur BCD - 7 segments
Chapitre 3. L'usage de l'outil QUARTUS II
Chapitre 4. Description comportementale
Chapitre 5. Projets : énoncés
Chapitre 6. Projets : vers la solution
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2.16.3. Encodeur BCD - 7 segments

 

 

L'allumage des segments pour les valeurs allant de 0 à 9 doit être :

 

La table de commandes des afficheurs doit être:

Valeur
A
B
C
D
E
F
G
0
0
0
0
0
0
0
1
1
1
0
0
1
1
1
1
2
0
0
1
0
0
1
0
3
0
0
0
0
1
1
0
4
1
0
0
1
1
0
0
5
0
1
0
0
1
0
0
6
0
1
0
0
0
0
0
7
0
0
0
1
1
1
1
8
0
0
0
0
0
0
0
9
0
0
0
0
1
0
0

 
Les équations sont :

A = e1 + e4

B = e5 + e6

C = e2

D = e1 + e4 + e7

E = e1 + e3 + e4 + e5 + e7 + e9

F = e1 + e2 + e3 + e7

G = e0 + e1 + e7

Le programme sera :

module Encod7Segments (e0, e1, e2, e3, e4, e5, e6, e7, e8, e9, A, B, C, D, E, F, G) ;

input e0, e1, e2, e3, e4, e5, e6, e7, e8, e9 ;

output A, B, C, D, E, F, G ;

assign A = e1 | e4 ;

assign B = e5 | e6 ;

assign C = e2 ;

assign D = e1 | e4 | e7 ;

assign E = e1 | e3 | e4 | e5 | e7 | e9 ;

assign F = e1 | e2 | e3 | e7 ;

assign G = e0 | e1 | e7 ;

endmodule

A la compilation, on remarquera que l'entrée e8 est ignorée et n'a aucune connexion extérieure. Elle n'apparait jamais dans les équations (aucun segment n'est à éteindre pour la valeur 8).

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